在读写DDR3之前，需要了解DDR3的相关知识，而如果一开始就直接看DDR3的话，我们极有可能会感觉到一头雾水，不知道从哪下手，接下来，我们便从SDRAM一步步到DDR3，分步去学习相关的知识。1SDRAM简介 从某种意义上来讲，SDRAM是现在内存的最初代产品，现在的DDR4包括DDR5都起源于它。SDRAM（SynchronousDynamicAccessMemory），是同步动态随机存储器。同步是指其时钟频率于CPU前端总线的系统时钟频率相同，并且内部的命令的发送与数据的传输都是以它为基准；动态是指存储阵列需要不断地刷新来保证数据不丢失：随机是指数据不是线性依次存储，而是自
芯片设计验证社区·芯片爱好者聚集地·硬件相关讨论社区·数字verifier星球四社区联合力荐！近500篇数字IC精品文章收录！【数字IC精品文章收录】学习路线·基础知识·总线·脚本语言·芯片求职·EDA工具·低功耗设计Verilog·STA·设计·验证·FPGA·架构·AMBA·书籍解读AXI协议中的burst突发传输机制一、写在前面二、burst突发传输机制解读2.1什么是burst传输2.2AXI4.0突发传输要求2.3信号列表2.3.1突发传输长度（burstlength）2.3.2突发传输大小（burstsize）2.3.3突发传输种类（bursttype）2.3.3.1FIXEDTy
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一、AXI——高级可扩展接口（UG1037）参考资源：【SDK篇_58~62_AXI接口简介【Xilinx】+【Vivado】+【AXI4总线】+【FPGA】-哔哩哔哩】关于AXI握手过程都讲解的很细致ug1037（三种AXI的介绍，相关AXIIP的介绍）IHI0022D（握手过程的详细介绍）FPGA_HP：AXI4的学习与使用1——基础知识积累这个博主写的其他内容也不错从零学习AXI4总线(二)：AXI4-Stream介绍带你快速入门AXI4总线–AXI4-Stream篇（1）----AXI4-Stream总线1、AXI接口介绍AXI是ARMAMBA的一部分。AMBA：开放的片内互联的总线标
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ZYNQ_FPGA_SPI通信协议多种实现方式填一下前面的坑。介绍关于Vivado中AXIQuadSPIv3.2的使用方法。参考资料：pg153-axi-quad-spi.pdf，可自行在官网下载。以该IP核的StandardSPIMode的使用为例。AddressSpaceOffsetRegisterNameAccessTypeDefaultValue(hex)Description40hSRRWriteN/ASoftwareresetregister60hSPICRR/W0x180SPIcontrolregister64hSPISRRead0x0a5SPIstatusregister68h
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数字IC全站文章索引demo版（建议收藏慢慢看）一、项目说明1.1索引目的1.2收录原则1.3投稿方式1.4版本迭代二、数字IC学习路线三、通用技能篇3.1数字电路3.2硬件描述语言(Verilog)3.3linux操作系统3.4C语言3.5微机原理3.6汇编语言3.7计算机组成原理3.8计算机体系架构3.9STA静态时序分析3.10SystemVerilog3.11UVM3.12SVA3.13信号与系统3.14数字信号处理四、总线、接口与协议4.1UART协议4.2SPI协议4.3I2C协议4.4AMBA协议4.4.1AHB4.4.2APB4.4.3AXI4.4.4AXI-stream4.4
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说明：1、本代码为原创设计，仅供学习使用。2、从这篇开始，这个专栏将正式进入到RTL设计阶段。3、这篇文章过后还会有AXI-lite，XilinxAXI主机等代码的分析，供大家学习参考。一、功能说明二、测试结果三、设计讲解四、RTL代码(Verilog)AXI2DPRAM双口RAM同步FIFO五、能够自动比对数据的仿真代码一、功能说明该设计为一个AXI4接口的双口SRAM，支持读写最大outstanding数为30。数据位宽为32bit，RAM深度为256。（可按需修改）支持burst方式为INCRburst长度支持1~16读写设计分离，不会产生访问阻塞。二、测试结果如上图所示，tb中先后向A
