锁相环（Phase-LockedLoops，PLL）电路的发明者是法国的H.deBellescize。为了简化当时广泛使用的超外差式无线接收机结构，消除因接收机本振频率漂移带来的噪声，Bellescize于1932年提出同步检波理论，首次公开发表了对锁相环路的描述，但当时并没有引起普遍的重视。直到20世纪50年代，随着电视机的实用化及普及，PLL电路才在电视机的垂直与水平同步电路中广泛采用。 锁相环电路的独特性能在于可以对输入信号的相位进行有效跟踪，从而可以在噪声之中提取出几乎完全纯净的信号，以及完成一些其他电路无法完成的功能，这正是锁相环电路的神奇之处。这一章，
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1.通信基础概念此篇为学习正点原子FPGA课程总结串行/并行通信串行通信即收发双方通过单根线进行数据传输，发送方有并转串逻辑，接收方有串转并逻辑。优点是占用IO少，成本低，缺点是速率低。并行通信一次用多根数据线传输。优点是速度快，缺点是占用IO多，成本高。单工/半双工/全双工通信单工通信：只能沿一个方向通信，如遥控器半双工通信：可以双方通信，不能同时通信。如传呼机全双工通信：可以双方同时通信，如电话同步/异步通信同步通信：收发双方有一根时钟线进行数据同步异步通信：没有这根时钟线，靠固定的数据格式、比特率等来同步2.UARTUART（UniversalAsynchronousReceiver-T
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