基于Quartus件完成一个1位全加器的设计，分别采用：1）原理图输入以及2）Verilog编程这两种设计方法。开发板基于IntelDE2-115。在此基础上，用原理图以及Verilog编程两种方式，完成4位全加器的设计，对比二者生成的RTL差别；使用modelsim验证逻辑设计的正确性，并在DE2-115开发板上实际验证。1位全加器可以用两个半加器及一个或门连接而成，因此需要先完成半加器的设计。下面将给出使用原理图输入的方法进行底层元件设计和层次化设计的主要步骤。一，半加器设计一，建立工程，创建工程过程（启动QuartusII软件，选择File->NewProjectWizard，在出现的界
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