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从封装中可以看出:
CLK的三角形表示边沿触发,即该D触发器为上升沿触发
SET和RESET均为低电平有效

由于SET和RESET都为低电平有效,所以在D触发器工作时,都要接高电平
当RESET为低电平时,触发器复位。
同步D触发器内部结构如下图所示

第一部分:

对应真值表:

第二部分:

为一个RS触发器
对应真值表:


利用与非门有 0 出 1 的特性,插入 S 和 R,将二输入与非门变成三输入与非 门,在电路中先将 S 定为 1 此时当 R 为 1 时,对与非门电路无影响, 当 R 为 0 时,无论 D 和 CP 取值如何,输出的 Q 固定为 0

当 CP 信号为 0 时,通过非门输入第一个触发器为 1,第一个触发器就会输出 D 相同的值,第二个触发器保持输出。当 CP 信号为 1 时,第一个触发器保持输 出,第二个触发器读取第一个触发器的输出值并输出,这就构成了一个上升沿 触发的 D 触发器
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