1.前言： 本代码是笔者参加2024年集创赛紫光同创赛道，在网上的代码，论文，课设等基础上编辑出来的一款带有GUI界面的数字变声器，变声效果良好，可以直接运行，有相关变换说明。 能够直接打开指定格式的音频文件，实现音频的播放暂停，具有男女声转换，童声转换的功能，且能显示音频的时域图，FFT频谱图，共振峰及基音周期转换前后零极点图，方便对比观察。2.开发日期： 2024.2~2024.33.开发环境： windows11，matlabR2023a4.音频前置处理： 建议用AU软件，去除音频前没有声音的部分（matlab在LPC
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGL50H开发平台（盘古50K）一：盘古50K开发板（紫光同创PGL50H开发平台）简介盘古50K开发板（紫光同创Logos系列PGL50H关键特性评估板）采用核心板+扩展板的结构，并使用高速板对板连接器进行连接。核心板由FPGA+2颗DDR3+Flash+电源及复位构成，承担FPGA的最小系统运行及高速数据处理和存储的功能。FPGA选用紫光同创40nm工艺的FPGA（logos系列：PGL50H-6IFBG484）。PGL50H和DDR3之间的数据交互时钟频率最高到400MHz，2
本原创文章由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGL50H开发平台（盘古50K开发板）本篇优秀作品：2023集创赛全国总决赛紫光同创杯赛一等奖获奖作品，来自东莞理工+BugMaker的内容分享。获奖作品：《基于紫光同创FPGA的图像采集及AI加速》获奖队伍：东莞理工学院+CICC1113+BugMaker作品评语：视频输入接口支持HDMI，摄像头，光口，网口，PCIE上位机识别MAP达70%，视频输入帧率最高支持70帧，支持yolov5和yolov8识别帧率高。速度性能上较为优异。部分成果及技术展示01整体框架流程图以上为我们的整
文章目录标题0致读者1实验任务2简介2.1UDP概述2.2IP协议2.3UDP协议3程序设计3.1总体设计3.2UDP接收模块设计3.3UDP发送模块设计3.4以太网控制模块设计4下载验证5总结标题0致读者此篇为专栏《紫光同创FPGA开发笔记》的第七篇，同时也是FPGA以太网入门的第三篇，记录我的学习FPGA的一些开发过程和心得感悟，刚接触FPGA的朋友们可以先去此博客《FPGA零基础入门学习路线》来做最基础的扫盲。本篇内容基于笔者实际开发过程和正点原子资料撰写，将会详细讲解此FPGA实验的全流程，诚挚地欢迎各位读者在评论区或者私信我交流！UDP是一种面向无连接的传输层协议，属于TCP/IP协
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处一：软件简介PangoDesignSuite是紫光同创基于多年FPGA开发软件技术攻关与工程实践经验而研发的一款拥有国产自主知识产权的大规模FPGA开发软件，可以支持千万门级FPGA器件的设计开发。该软件支持工业界标准的开发流程，可实现从RTL综合到配置数据流生成下载的全套操作。二：支持平台三：软件安装一般地，将软件安装在C:\pango\PDS_2022.1；（此为默认安装路径）。软件安装完成后，会在桌面以及程序菜单中添加快捷方式PangoDesignSuite2022.1；在程序菜单PangoDesi
FPGA，即现场可编程门阵列，作为可重构电路芯片，已经成为行业“万能芯片”，在通信系统、数字信息处理、视频图像处理、高速接口设计等方面都有不俗的表现。近几年，随着国家战略支持和产业发展，国产FPGA迎来迅猛发展。国产FPGA由于拥有高性价比、完整自主可控知识产权产业链，越来越成为行业热门选择。作为国产FPGA专业厂商紫光同创生态合作伙伴，小眼睛科技一直深耕FPGA产品和解决方案，基于紫光同创器件，推出100%国产化高性能盘古系列FPGA方案和开发套件，为客户提供专业且高效的FPGA产品和服务支持。2024年，小眼睛科技全新打造盘古系列新品，满足全方位的开发需求，产品覆盖Logos/Logos2
目录1、前言免责声明2、我这里已有的GT高速接口解决方案3、设计思路框架设计框图OV5640摄像头配置及采集视频数据封装按键选择HSSTLP高速收发器详解HSSTLP基本了解HSSTLP之时钟HSSTLP之PCSHSSTLP之PMAHSSTLP之接口说明硬件设计HSSTLPIP调用和配置SFP连接方案选择视频数据对齐视频数据解码图像缓存架构详解架构讲解视频缓存请求AXI总线HMIC_H图像缓存读写逻辑输出视频时序sil9134配置4、PDS工程详解5、上板调试验证并演示准备工作静态演示6、福利：工程源码获取紫光同创FPGA实现HSSTLP高速接口视频传输，8b/10b编解码，OV5640采集，
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处适用于板卡型号：紫光同创PGL22G开发平台（盘古22K）一：盘古22K开发板（紫光同创PGL22G开发平台）简介盘古22K开发板是基于紫光同创Logos系列PGL22G芯片设计的一款FPGA开发板，全面实现国产化方案，板载资源丰富，高容量、高带宽，外围接口丰富，不仅适用于高校教学，还可以用于实验项目、项目开发，一板多用，满足多方位的开发需求。二：实验目的MES22GP开发板上有一片Micron的DDR3（MT41K256M16TW107：P）内存组件，拥有16bit位宽的存储空间（MT41J系列是旧的产品，
文章目录基于紫光同创FPGA的DDR3读写实验0致读者1实验任务2简介2.1DDR3简介2.2AXI4协议简介2.2.1AXI4读时序2.2.2AXI4写时序3硬件设计4程序设计4.1总体模块设计4.2顶层模块设计4.3ddr3控制模块设计4.4ddr3读写控制器模块设计4.5ddr3控制器fifo控制模块设计4.6ddr3测试数据模块设计4.7LED显示模块设计5仿真验证6总结基于紫光同创FPGA的DDR3读写实验0致读者此篇为专栏《紫光同创FPGA开发笔记》的第二篇，记录我的学习FPGA的一些开发过程和心得感悟，刚接触FPGA的朋友们可以先去此专栏置顶《FPGA零基础入门学习路线》来做最基
文章目录紫光同创PDS软件使用——常用IP核的理解与配置0致读者1`PLL`IP核1.1实验任务1.2PLLIP核简介1.3IP核配置讲解2单端口`RAM`IP核2.1实验任务2.2单端口RAMIP核简介2.3IP核配置讲解3双端口`RAM`IP核3.1实验任务3.2双端口RAMIP核简介3.3IP核配置讲解4`FIFO`IP核4.1实验任务4.2FIFOIP核简介4.3IP核配置讲解5总结紫光同创PDS软件使用——常用IP核的理解与配置0致读者此篇为专栏《紫光同创FPGA开发笔记》的第三篇，记录我的学习FPGA的一些开发过程和心得感悟，刚接触FPGA的朋友们可以先去此博客《FPGA零基础入门
