一、前言RouteKeepout即禁止布线区，通常会在绘制元件封装的时候就给元件画上的，目的在于让这个元件的这块区域不能走线或者不让走线碰到这块区域，否则就会显示DRC符号报错，只不过这个错误在Allegro软件中是黄色警告，不是红色错误。但有时候你这个元件得设置禁止布线区，同时你又必须要在上面走线，这种情况下这个DRC或许就分时候去选择需要和不需要了，举个例子：PCIE走线。如下图如图，当走线碰到禁止布线区的时候就会报DRC：LinetoRouteKeepoutSpacing要消除这个DRC，直接删掉这个禁止布线区当然是可以的，但这操作多少感觉有些不合理，所以还是通过设置来让其允许布线。二、
一、前言RouteKeepout即禁止布线区，通常会在绘制元件封装的时候就给元件画上的，目的在于让这个元件的这块区域不能走线或者不让走线碰到这块区域，否则就会显示DRC符号报错，只不过这个错误在Allegro软件中是黄色警告，不是红色错误。但有时候你这个元件得设置禁止布线区，同时你又必须要在上面走线，这种情况下这个DRC或许就分时候去选择需要和不需要了，举个例子：PCIE走线。如下图如图，当走线碰到禁止布线区的时候就会报DRC：LinetoRouteKeepoutSpacing要消除这个DRC，直接删掉这个禁止布线区当然是可以的，但这操作多少感觉有些不合理，所以还是通过设置来让其允许布线。二、
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allegro怎样制作和添加logo？1、先制作好bmp格式的文件2、Allegro中新建一个formatsymbol文件3、Logo的调用软件环境：cadence16.6前言：在制作pcb的时候有时会想放置自己的logo来标记自己的产品，下面来介绍一下在allegro中制作logo的方法1、先制作好bmp格式的文件 allegro中制作logo是需要“.bmp”格式的文件。这里的话我们用电脑自带的“画图”来做一下演示。如下图所示，先在“画图”中制作出logo，然后再另存为.bmp格式的文件。（当然用其他方法制作bmp文件也行）图1-1用“画图”制作logo图案图1-2另存为bmp格式图1-
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CadenceAllegro导出Gerber文件CadenceAllegro版本设置导出Gerber路径检查PCB状态DatabaseCheck检查Gerber文件中的孔符生成钻孔表生成钻孔文件生成异型孔文件生成坐标文件生成ArtworkGerber文件处理及压缩生成IPC网标DRC排查方法1方法2CadenceAllegro版本AllegroPCBDesigner17.4-2019设置导出Gerber路径Setup>>UserPreferences...>File_management>>Output_dir>>ads_sdart>>Value:Gerber-PRO_NAME_HW_VERG
