UVM_草庐IT

电力电子转战数字IC——我的IC面试（2022.10.14更新）

目录感谢信 HKWS10.14面试25minsJXC10.13面试30minsJDSK9.23面试42mins快速的自我介绍介绍一下这个MCDF的项目你这里写SV搭建的验证环境，和UVM搭建的有什么区别吗你这里写了覆盖率的收集，功能覆盖率是怎么收集的，有哪些功能点？代码覆盖率有哪些？写一个队列，然后找出队列中第一个元素是3的位置？介绍一下TLM通信？你在这个项目里用到了那些tlm？你怎么看寄存器模型？这里写到APB总线，简单介绍下APB总线？为什么用APB，为什么不用别的总线？介绍下APB总线的工作原理？还问了ready和valid信号的情形，但是我答不出来，想不起APB的工作原理了。你这里

mdash 转战 E4 E5 xff0c 面试经验分享 fpga开发数字IC UVM

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【从零开始学习 UVM】3.8、UVM TestBench架构 —— UVM Agent [uvm_agent]

文章目录什么是UVMAgent？所有的AgentType是什么？如何确定UVMAgent是主动还是被动的？创建UVM代理的步骤一个UVM代理做什么？如何将UVM代理配置为主动或被动？一个UVMAgent例子推荐做法什么是UVMAgent？一个Agent将Sequencer、Driver和Monitor封装成一个单一实体，通过实例化并通过TLM接口连接这些组件。由于UVM是关于可配置性的，因此代理还可以具有配置选项，例如UVM代理类型（主动/被动），旋钮以打开功能覆盖等功能，并具有其他类似参数。所有的AgentType是什么？代理类型描述Active

UVM mdash Agent li $数字IC $数字IC验证

【从零开始学习 UVM】3.8、UVM TestBench架构 —— UVM Agent [uvm_agent]

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初识m_sequencer、p_sequencer和uvm_declare_p_sequencer宏

一、m_sequencer1、什么是m_sequencerm_sequencer是定义在uvm_sequencer_item中的，uvm_sequencer_base类型的句柄，也就是说m_sequencer是uvm_sequencer_item的成员变量m_sequencer是指向uvm_sequencer_base的句柄任何派生于uvm_sequencer_item的类都会拥有一个m_sequencerm_sequencer源码如下：classuvm_sequence_itemextendsuvm_transaction;...protecteduvm_sequencer_basem_se

sequencer uvm_declare_p_sequencer m_sequencer sequence Verilog

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