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【《硬件架构的艺术》读书笔记】04 时钟分频器

4.1介绍偶数时钟分频很好实现,使用一个计数器累加到一定值再清零,同时翻转电平就可以了。本章主要讲的是奇数分频和小数分频。4.2同步整数分频器使用Moore状态机可以轻松的实现同步整数分频,需要几分频就有几种状态,但是如果是奇数分频,那么输出就不可能为50%占空比。  如图使用了一个七个状态的Moore状态机实现了7分频,其中4个状态输出为0,3个状态输出为1,显然占空比不为50%4.3具有50%占空比的奇数整数分频1、以期望输出频率的一半产生两个正交相位时钟(90°相位差)。2、将两个波形异或得到输出频率。对于整奇数N分频:1、创建一个计数到N-1的计数器。2、使用两个T触发器,并且第一个触

【《硬件架构的艺术》读书笔记】03 处理多个时钟(2)

3.6握手信号方法 1)X将数放在数据总线上兵发出xreq信号,表示有效数据已经发到接收器Y的数据总线上。2)xreq信号同步到接收器时钟域ylk上。3)Y在识别xreq同步的信号yreq2后,锁存数据总线上信号。4)Y发出确认信号yack,表示其已经接收了数据。5)yack同步到发送时钟xclk上。6)X识别到同步的xack2信号后,将下一个数据放到数据总线上。如图,安全地将一个数据从发送器传输到接收器需要5个时钟周期。3.6.1握手信号的要求数据应在发送时钟域内稳定至少两个时钟上升沿。xreq宽度应该超过两个上升沿时钟,否则从高速时钟域到低速时钟域传递可能无法捕捉到该信号。3.6.2握手信

【《硬件架构的艺术》读书笔记】03 处理多个时钟(2)

3.6握手信号方法 1)X将数放在数据总线上兵发出xreq信号,表示有效数据已经发到接收器Y的数据总线上。2)xreq信号同步到接收器时钟域ylk上。3)Y在识别xreq同步的信号yreq2后,锁存数据总线上信号。4)Y发出确认信号yack,表示其已经接收了数据。5)yack同步到发送时钟xclk上。6)X识别到同步的xack2信号后,将下一个数据放到数据总线上。如图,安全地将一个数据从发送器传输到接收器需要5个时钟周期。3.6.1握手信号的要求数据应在发送时钟域内稳定至少两个时钟上升沿。xreq宽度应该超过两个上升沿时钟,否则从高速时钟域到低速时钟域传递可能无法捕捉到该信号。3.6.2握手信

【《硬件架构的艺术》读书笔记】03 处理多个时钟(3)

3.8异步FIFO(双时钟FIFO)  如上图,X通过xclk将数据写入FIFO,Y通过yclk将数据读出。注意这里写满标志信号在写时钟域,空信号在读时钟域。对比握手信号,异步FIFO用于对性能要求较高的设计中,尤其是时钟延迟比系统资源更重要的环境中。异步FIFO主要需要注意信号亚稳态的问题。3.8.1避免用二进制计数器实现指针如果使用二进制计数,一次可能变换多位,这时就需要将多位数据同步到另一个时钟域,很容易造成错误。3.8.2使用格雷码取代二进制计数格雷码优势是在一个数变成另一个数时,只有一位出现变化。所以其在转换中最多只会一位错误,读取时要么读到旧值,要么读到新值,但是不会读到其他值。3

【《硬件架构的艺术》读书笔记】03 处理多个时钟(3)

3.8异步FIFO(双时钟FIFO)  如上图,X通过xclk将数据写入FIFO,Y通过yclk将数据读出。注意这里写满标志信号在写时钟域,空信号在读时钟域。对比握手信号,异步FIFO用于对性能要求较高的设计中,尤其是时钟延迟比系统资源更重要的环境中。异步FIFO主要需要注意信号亚稳态的问题。3.8.1避免用二进制计数器实现指针如果使用二进制计数,一次可能变换多位,这时就需要将多位数据同步到另一个时钟域,很容易造成错误。3.8.2使用格雷码取代二进制计数格雷码优势是在一个数变成另一个数时,只有一位出现变化。所以其在转换中最多只会一位错误,读取时要么读到旧值,要么读到新值,但是不会读到其他值。3

【时间基准】NTP网络时钟服务器助力智能农业系统

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普冉PY32系列(四) PY32F002A/003/030的时钟设置

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LED电子时钟屏(时间同步屏)与NTP网络时钟系统组成

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